《東京/北海道》【2nmプロセス】デジタルIC設計フロー開発エンジニア｜次世代PPA最適化の旗振り役

世界的に先端ロジックプロセスの開発競争が激化する中、2nmクラスプロセスに対応したデジタルIC設計フローの整備は、半導体メーカーにとって重要なテーマとなっています。
特に、Cadence／SynopsysといったEDAツールを2nmプロセスに最適化し、PPA（Power, Performance, Area）を最大化できるフローを構築することが、顧客の設計競争力を左右します。
本ポジションでは、EDAベンダと連携しながら設計フローの構築・検証を行い、ベンチマークデータを用いたPPA評価とチューニングを通じて、実用的かつ高品質なフローを作り上げていきます。あわせて、構築したフローを顧客に提供し、導入支援や技術サポートを行うことで、先端プロセスを活用した設計環境の立ち上げを支援します。先端半導体開発の基盤となる設計フローづくりに関わりたい方を募集中です。

■数字で見るテクノプロ・デザイン社（2025年9月末時点）
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・売上　　　　　　：720.8億円
・取引会社数　　　：796社
・拠点数（国内）　：本社、営業拠点32、受託開発センター11
（仙台・川崎・湘南・五反田・三田・名古屋・刈谷・大阪・神戸・福岡・北九州）
・技術社員数（正社員・契約社員計）：8,450名
・プロジェクト数　：常時1000以上
・上流工程比率　　：77%
・有給取得日数　　：15.1日
・研修受講人数　　：140,874名
・男性育休取得率　：57％
・女性産休・育休取得率：100％
・平均年齢　　　　：39.1歳

■主要得意先（2025年6月末時点）
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・日立グループ
・デンソーグループ
・三菱電機グループ
・SUBARUグループ
・ホンダグループ
・ソニーグループ
・トヨタグループ
・日本電気グループ
・東京エレクトロングループ
・日産グループ

★プライム上場企業を中心に796社のお客様とお取引をしています

先端ロジックプロセスを扱う半導体メーカー向けに、EDAベンダと連携しながらデジタルIC設計フローの構築・最適化を行います。Cadence／Synopsysの主要なデジタル設計ツールを用いて、論理合成・配置配線・タイミング解析などのフローを2nmプロセス向けに構成し、設計現場で実際に活用できる形に整備していきます。
構築したフローについては、テストチップやリファレンスデザイン等のベンチマークデータを用いて、PPA（消費電力・性能・面積）の観点から評価を実施します。
評価結果をもとに、ツールオプションやスクリプトのパラメータ調整などを行い、より良い設計結果が得られるようにフローをチューニングします。
最終的に整えた設計フローパッケージは、顧客へ提供し、導入支援や運用時の技術サポートを実施します。
顧客の設計課題に対しては、問題の切り分けや共同デバッグ、運用上の改善提案を行い、実務で活用されるフローとして継続的なブラッシュアップも担います。EDAベンダ・プロセス開発チーム・顧客設計チームと連携しながら、先端設計フローの品質と使いやすさを高めていくポジションです。

【具体的な仕事内容】
・2nmプロセス対応のCadence／Synopsysデジタル設計フローの構築・検証
・設計フローのカスタマイズ、およびツール動作の検証・評価
・テストチップ／リファレンスデザインを用いたPPA評価（電力・性能・面積）
・PPA向上を目的としたフローのパラメータチューニング・スクリプト改善
・設計フローパッケージの顧客提供、導入支援、技術サポート
・顧客設計課題に対するソリューション提案および共同デバッグ
・EDAベンダ／社内外関係者との技術的な調整・情報共有

【この仕事のおもしろさ・魅力】
① 役割・裁量面の魅力
2nmクラスの先端プロセスに対応した設計フローを、自ら構築・検証しながら最適化していくポジションです。EDAベンダや顧客と連携しつつ、フローのあり方を主体的に形にできます。
② 成長機会・スキル習得の魅力
Cadence／Synopsysツールの深い理解に加え、PPA最適化や先端プロセス特有の設計要件など、デジタル設計者としての市場価値を高める経験が得られます。
③ 顧客折衝・上流工程への関与など業務面の魅力
フロー構築だけでなく、顧客への技術サポートや課題解決にも関わるため、「ツールを使う側」だけでなく「設計環境を作る側」として携われる点が魅力です。

原則屋内禁煙
ただし、就業場所により異なる